TIA Probleme mit Slice im SCL

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Ich hatte letztens noch n Bauteil inner Hand das mit V16 nicht, mit V16-2 aber schon ging. Glaub war eine der ET200M-Stationen, bin mir aber nicht ganz sicher. Sie tauchte im Hardwarekatalog nicht auf.

Naja, Hardwarekatalog ist ja nur zwingend für zentrale Baugruppen notwendig, dezentrale Baugruppen kannst Du ja so gut wie immer mit GSD(ML)-Datei verwenden...

Immerhin wird AWL vermutlich in 17, 18, 19 - irgendwann, abgeschafft.

Ähnlich die Systemmerker, Taktmerker, eigentlich der gesamte Merkerbereich. Irgendwann verschwindet er vielleicht

Woher hast Du denn diese Info??? Ich glaub das nicht... Vielleicht mit der Einführung der S7-1600 oder S7-1700

Aktuell ist AWL noch eher zwischen allen TIA-Versionen kompatibel als SCL...

Gruß.
 
Naja, Hardwarekatalog ist ja nur zwingend für zentrale Baugruppen notwendig, dezentrale Baugruppen kannst Du ja so gut wie immer mit GSD(ML)-Datei verwenden...
Ja, GSD lassen sich fast immer nutzen. Habe das nicht in Betracht gezogen da im Updatekatalog die Baugruppen auftauchten.
Woher hast Du denn diese Info??? Ich glaub das nicht... Vielleicht mit der Einführung der S7-1600 oder S7-1700

Aktuell ist AWL noch eher zwischen allen TIA-Versionen kompatibel als SCL...

Gruß.

Das ist wohl "die" Glaubensfrage seit Erscheinen von TIA, und jeder AWL-Liebhaber findet bestimmt sehr gute Gründe warum es bleiben wird.
Für die anderen gilt:
- unübersichtlich
- schwer wartbar
- kompliziert, u.a. durch extreme Registernutzungen (die nebenbei bemerkt "nur noch aus Kompatibilitätsgründen emuliert werden")
- Siemens schult seine eigenen Mitarbeiter nur noch spärlich in AWL, dafür verstärkt SCL, C/C++, AWL-Kurse verschwinden nacheinander bzw. tauchen als Erweiterung zur Interpretation auf.

Mit ist das persönlich wurscht, aber meine Kunden wollen von mir kein Programm, auch nicht in Teilen, in AWL haben, eben aus vorgenannten Gründen der Übersichtlichkeit.
Und wer weiß, vielleicht wird in 17, 18, 19, ... ja die S7-1600/1700 eingeführt?

Eine Diskussion will ich hier eigentlich nicht hervorrufen, die gibt es an so vielen Stellen schon oft genug.

Vielleicht ein Anreiz: Im Progammierstyleguide ist 2020 AWL erstmals vollständig entfernt worden, der Hinweis "vorrangig in SCL" zu programmieren existiert nicht mehr, wird offensichtlich als gegeben hingenommen. Aber was bedeutet das schon? Ich mein, im Leitfaden schreibt Siemens selbst das man anstelle von Graph besser FUP/KOP nutzen solle und eigene Bausteine schreiben weil es schneller abgearbeitet wird.
 
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Weiß jemand ob diese AT überlagerung in TIA V17 noch funktioniert, denn ich bekomme es derzeit nicht hin wenn ich nach dieser Anleitung gehe? Möchte einfach bisschen rumprobieren in SCL und entweder 8 Bool in ein Byte oder 2 byte in ein Int schreiben ohne die gather funktion benutzen zu müssen.
 
Dann zeig doch mal was du machst und wie du es machst ...
Aber als Tip : du kannst immer nur eine Deklaration mit einer anderen überlagern
 
Glaskugelmodus (nach nochmaligem Lesen) :
Es geht z.B. :
Array[1..2] of Byte überlagert mit WORD
aber nicht
2 verschiedene Byte-Deklarationen mit einem WORD
 
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Achso jetzt passt es. Nebenbei Hast du ein vllt. ein verstädnliches Video oder Eintrag wo beschreibt wie genau die Explizite Konvertierung von BOOL_TO_BYTE funktioniert?
 
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