Step 7 Rätsel-Frage

[Cläusle]

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Guten Abend,

Markus meint, ich solle meine Frage hier irgendwo stellen.... dann mache ich das mal.

ich bin auf der Suche nach einem Hinweis zu einer Seite, die mir weiter hilft..
Es geht um ein Rätsel in Form einer Schaltung mit Logikgattern, das mit Simatic überschrieben ist.
Bei den normalen Gattern kann ich mir einen Reim darauf machen, was da passiert.... grundsätzlich.

Was muss ich mir hier vorstellen?
Das E0.0 steht irgendwie für einen Speicherort?
_____________
| >=1 |
E0.0 ---| |
"Log_1"---| |---
| ------------|

Und sowas habe ich noch nicht gefunden, vermute aber, CMP steht für Vergleich.
_____________
| CMP == I |
EW24---| IN1 |
22---| IN2 |---
|-------------|

Wo finde ich da mehr dazu als in Wikipedia mit seinen 7 Logikgattern?
Im Anhang hab ich mal das PDF für Nord angehängt.

Vielen Dank im Voraus

Claus Gittner

 

[Plan_B]

Nimmst Du ein Buch für FUP- Programmierung.
E0.0 ist ein binäres Eingangssignal an einem Digitaleingang.
CMP==I ist ein Vergleich zweier Ganzzahlen m. Vorzeichen im 16bit Bereich.

 

[circlehook]

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Woher kommt der FC und was soll das?
Der Code darin ist wirklich "besonders".

 

[Larry Laffer]

welchen Sinn soll übrigens dein "Programm" im FC1 haben ?

 

[Cläusle]

Mit FUP bin ich glaub ich schon mal einen guten Schritt weiter.
Werde ich mir morgen mal anschauen.

Und das Ganze ist kein - im Sinne der Simatic - sinnvolles Programm.
Das ist eine Rätselaufgabe, die Logikgatter benutzt und hinten eine dreistellige Zahl auswerfen soll.

 

[PN/DP]

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Wenn du die gemalten Bilder hier mit [CODE]-Tags einfügst, dann sind sie besser lesbar.

Was muss ich mir hier vorstellen?
Das E0.0 steht irgendwie für einen Speicherort?

           _____________
          | >=1         |
  E0.0 ---|             |
"Log_1"---|             |---
          | ------------|

Und sowas habe ich noch nicht gefunden, vermute aber, CMP steht für Vergleich.

        _____________
       | CMP == I    |
EW24---| IN1         |
  22---| IN2         |---
       |-------------|

Das obere ist eine OR-Verknüpfung des Prozessabbildes des Eingangs E0.0 und vermutlich einem Merker, der immer 1 ist.
Das untere ist ein 16 Bit Ganzzahl-Vergleich des Eingangs-Words EW24 mit dem konstanten Wert 22 ( 16#0016, 2#0000_0000_0001_0110 )
Hilfe bekommst du, wenn du das FUP-Symbol markierst und F1 drückst.

 

[Marvm]

Wie vorher schon geschrieben wurde ist:

E0.0 ein Eingang der SPS

CMP == I vergleicht zwei Variablen miteinander und wird True wenn diese gleich sind.
Hier wird die Zahl 22 mit dem Inhalt vom Eingangswort 23 verglichen

"Log_0" wird eine Variable sein die immer False ist
"Log_1" wird eine Variable sein die immer True ist

Von Daher wird der Teil mit dem CMP keine auswirkung haben weil am folgenden UND Baustein ein "Log_0" ist.
Dadurch das die ersten beiden Anschhlüsse an dem XOR immer TRUE sind und der dritte immer False ist das Ergebnis vom XOR immer False.

So wie ich es sehe wird der Ausgang 0.0 (A0.0) immer angesteuert sein.

 

[Plan_B]

So wie ich es sehe wird der Ausgang 0.0 (A0.0) immer angesteuert sein

Es geht um eine dreistellige Zahl, vermutlich gebildet aus den 10 Ausgangsbits im Rätsel.

 

[Rycker64]

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Es geht um eine dreistellige Zahl, vermutlich gebildet aus den 10 Ausgangsbits im Rätsel.

Das scheint wirklich so der Fall zu sein, allerdings Meines Wissens müßten wir dann alle 16 bits haben denn unsere Simatic schreibt ja das Ausgangswort als (Byte n) + (Byte n+1) Bit 15 das Vorzeichen aber Bit 0 entspricht ja dem A1.0 und Bit 15 dem A0.7.
Kurz überflogen gäbe der "FC1" ein Bit muster von "00110001 ??????10" Was wieder sinnlos wäre.
Vielleicht meint der Fragesteller auch es wird von A0.0 nach A1.1 von links nach rechts adressiert und es gäbe dann "1000110001"
Dann ist 561 das Ergebnis. Schauen wir mal ob es eine Lösung für Das krude Rätsel gibt

 

[Plan_B]

wirklich so der Fall zu sein, allerdings Meines Wissens müßten wir dann alle 16 bits haben

Hääää?
Der TE schreibt doch, dass es kein gültiges Programm ist.
Bits fortlaufend, kein VZ. Wo bit 0 zu liegen hat, wäre tatsächlich interessant. Ich würd a0.0 nach rechts legen

 

[Heinileini]

... allerdings Meines Wissens müßten wir dann alle 16 bits haben ...

Wie wär's mit
A0.0 .. A0.3 für die EinerStelle,
A0.4 .. A0.7 für die ZehnerStelle und
A1.0 .. A1.1 für die HunderterStelle,
also alles als BCD-Zahl?
Das reicht für die Zahlen 0 .. 399.

Die Zahl 999 dual codiert wäre 3E7. Auch hierfür genügen 10 Bit.

 

[Cläusle]

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Ich seh schon, hier bin ich richtig.
Um das zu verstehen, drösel ich den ersten Knoten auf, also was A.0.0 ergeben soll

1. Spalte
VERGLEICH: EW24 und 22 werden verglichen , beide müssen Integer sein. Wenn identisch, dann 1 sonst 0 = 0
2. Spalte
UND: Log_0 und Log_1 sind unterschiedlich. Wenn beide 1, dann 1 sonst 0 = 0
ODER; Von E0.0 und Log_1 muss einer 1 sein, dann 1 sonst 0 = 1
UND: Der unterste Eingang ist 0. Wenn alle1, dann 1 sonst 0 = 0
3. Spalte
XOR: Wenn alle Werte gleich sind, dann 0 sonst 1 = 1
ODER; Von Log_0 und Log_1 muss einer 1 sein, dann 1 sonst 0 = 1
4 Spalte
UND_ 2 Eingangswerte 1. Wenn beide 1, dann 1 sonst 0 = 1
5. Spalte
ZUWEISUNG: Eingang = Ausgang = 1

Hab ich das richtig verstanden?

 

[LargoD]

Ist das ein Teil von einem Geocache?

 

[Cläusle]

Ja, LargoD, so ist es..... GC448CJ

 

[Rycker64]

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Okay also sollte die 3 stellige Zahl 448 sein, Angenommen die Bits werden einfach aufregeiht
A0.0 = Links Bitmuster 1100101101 = Dez. = 813
A0.0 = Rechts Bitmuster 1011010011 = Dez. = 723
Bitmuster von 448 wäre 111000000 , dies bekomme ich aber in keiner "Logischen" Konstellation hin.
Wie schaut dann die Lösung aus?

 

[Heinileini]

...
3. Spalte
XOR: Wenn alle Werte gleich sind, dann 0 sonst 1 = 1
...

Das gilt bei XOR-Verknüpfungen mit 2 Eingängen. Es gilt nicht bei "XOR"-Verknüpfungen mit 3 oder mehr Eingängen.
Darum gibt es keine XOR-Verknüpfungen mit 3 oder mehr Eingängen! Und wenn doch, dann haben sie nicht den Namen XOR, also exklusiv-ODER verdient.
Du verwendest in NetzWerk 1 (Bild in Beitrag #1) ein XOR mit 3 Eingängen. Falls der Editor nicht bereits das Anlegen einer XOR-Verknüpfung mit mehr als 2 Eingängen verhindert, so finde ich, sollte man freiwillig auf XOR-Verknüpfungen mit mehr als 2 Eingängen verzichten.

Natürlich kann man mehrere XOR mit je 2 Eingängen zu Schaltungen mit mehr als nur 2 Eingängen zusammenbauen ("kaskadieren").
Aber hier gilt: Am Ausgang erhält man TRUE, wenn eine ungerade Anzahl Eingänge TRUE ist.
Dies wird z.B. zur ParitätsErmittlung benutzt.

 

[Cläusle]

Morgen,

ich hab jetzt länger rumprobiert, aber scheitere wohl kläglich.

Für FC1 habe ich 1000100011 binär oder 547 dezimal ermittelt.
Ob das stimmt, kann ich erst prüfen, wenn ich auch FC2 gelöst haben

Im FC 2 hänge ich bereits am Anfang mit SR und RS.
Also frage ich jetzt mal voller Demut nach der Lösung für FC2 (Datei hängt hier mit dran) und einer Überprüfung von FC1

wer erbarmt sich meiner?

 

[Rycker64]

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Hallo Cläusle,
also die ersten beiden Netzwerke (Sinnhaftigkeit mal aussen vor) solltest Du mit etwas "Einarbeitung" und der Tipps und Erklärungen im ersten Post lösen können. Schon der Hinweis auf die Lektüre und Beschreibung der logischen Bauteile.
XOR wurde erklärt und was ein RS-Glied oder SR-Glied ist, sollte sehr leicht zu lösen sein.
Zum FC1 wäre es sehr interesant zu erfahren "Wie" du auf dein Bitmuster kommst. Schon die Frage Bit0 rechts oder Links ist ja noch offen.
Also würde ich sagen ein wenig lesen und ein bischen Einsatz.
Frisch auf ans Werk.
Die Schmuckfedern sind um so schöner wenn es die Eigenen sind

 

[PN/DP]

Wenn man nicht durch logische Analyse des Programms auf die Lösung kommt, dann könnte man das Programm auch mit PLCSIM simulieren...

 

[Cläusle]

Mahlzeit,

bei FC1 hab ich von rechts nach links notiert.... schien mir logisch.
Und ddiese PLCSIM besorge ich mir mal. Hab mich eingetragen, jetzt wird mein Antrag geprüft und dann lade ich mir das mal runter.
Also - hier erstmal keine weiteren Lösungen. Allenfalls Seiten oder Suchbegriffe, auf die ich noch nicht gestossen bin.